Posted:
March 03, 2026
Location:
Shenzhen, Guangdong Province, China
Job Description
芯片架构师 深圳 分享 1.负责SoC架构方案设计，包括：总线拓扑、QoS策略、地址翻译、访存行为以及IO设备与CPU 的Cache一致性维护方案；
2.负责SoC架构性能调优，包括：总线数据通路、DDR访问、IO一致性访问通路的延时、效率和带宽优化，制定全芯片QoS策略；
3.负责加速器IP的访存子系统、硬件调度、中断聚合等行为规范和方案的制定，与SoC的访存系统联合调优；
4.负责SoC系统和加速器IP的PPA指标制定和优化。 岗位要求 1.本科及以上学历，电子信息、计算机或集成电路相关专业，10年以上工作经验；
2.对总线拓扑优化、Cache行为和性能优化、DRAM性能优化核IO一致性访问性能优化方面有相关成功项目案例；
3.对SoC系统及的QoS策略制定和调优方面有较深的理解；
4.至少负责过1个先进工艺mm2以上的总线、存储系统的项目经验，并负责过子系统级别的PPA和交付工作；
5.对CPU的中断、访存行为有一定理解，尤其是Cache Coherence 和Memory Consistency方面相关的知识背景。
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收藏 TEG 点击了解更多BG信息 技术 十年以上工作经验 更新于年02月11日 岗位职责2.负责SoC架构性能调优，包括：总线数据通路、DDR访问、IO一致性访问通路的延时、效率和带宽优化，制定全芯片QoS策略；
3.负责加速器IP的访存子系统、硬件调度、中断聚合等行为规范和方案的制定，与SoC的访存系统联合调优；
4.负责SoC系统和加速器IP的PPA指标制定和优化。
2.对总线拓扑优化、Cache行为和性能优化、DRAM性能优化核IO一致性访问性能优化方面有相关成功项目案例；
3.对SoC系统及的QoS策略制定和调优方面有较深的理解；
4.至少负责过1个先进工艺mm2以上的总线、存储系统的项目经验，并负责过子系统级别的PPA和交付工作；
5.对CPU的中断、访存行为有一定理解，尤其是Cache Coherence 和Memory Consistency方面相关的知识背景。
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Job Type:
Full-time
Location:
Shenzhen, China
Posted:
March 03, 2026
Deadline:
April 12, 2026